FIFO - 第1页 - 电工技术网

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使用PLD内部锁相环解决系统设计难题

引言微电子技术的发展趋势是片上系统（SoC），也就是在一块芯片上实现整个系统，包括模拟部分和数字部分。作为IC产业中重要的一个分支，可编程逻辑器件（PLD）也在努力向这个方向发展。无论是Xilinx还是Altera，它们最新的PLD产品中都集成了诸如PCI接口、乘法器、MCU核以及DSP核等部件，...

2023-06-13 PLD 内嵌锁相环 FIFO XBUS 文章课设毕设时钟类

基于FPGA的片上系统和嵌入式系统的远程监控系统

本系统立足于利用Intemet实现核环境信息的远程采集。在实现上，采用了基于SOPC技术的嵌入式解决方案，通过在FPGA中嵌入NioslI软核处理器和所需外设的IP Core(硅知识产权核)，然后再配备相应的网络接口，实现利用互联网进行信息的传输。1 系统硬件设计及实现在本系统的设计中，硬件...

2023-06-13 IP FPGA 寄存器 FIFO 文章技术应用嵌入式开发

关于串口FIFO中断

串口FIFO中断有;RDA CTI串口的接收模块包括接收缓冲寄存器和移位寄存器。接收的数据进入移位寄存器后经移位处理并行传入缓冲寄存器，事实上，UART的FIFO是一个硬件环形的缓冲队列，物理上不可寻址，不可见，仅U0RBR这个FIFO出口可见。U0RBR就是接收FIFO的第一位。FIFO的长度是可设...

2023-06-13 串口 FIFO 串口中断文章单片机基础知识

基于FPGA的ARINC429通信协议设计实现

某机载数据传输设备(以下简称：机载数传设备)主要用来完成空-空、空-地数据信息的传输，与HF或U／VHF频段电台配合使用，将专用计算机发来的待传信息，经过差错控制编码后，经电台调制、发射；对电台接收机送来的数据，进行校正、纠错和译码，还原成原始信息，传输给专用计算机(CUB)处理。要...

2023-06-13 FPGA SOPC ARINC429 FIFO NiosⅡ处理器文章课设毕设通信类

高速异步FIFO的设计与实现

引言现代集成电路芯片中，随着设计规模的不断扩大．一个系统中往往含有数个时钟。多时钟带来的一个问题就是，如何设计异步时钟之间的接口电路。异步FIFO(First In First Out)是解决这个问题的一种简便、快捷的解决方案。使用异步FIFO可以在两个不同时钟系统之间快速而方便地传...

2023-06-13 FIFO FPGA RAM VHDL 文章课设毕设论文

用FIFO实现超声测厚系统A/D与ARM接口设计

在高频超声波数据采集系统中,很多高速A／D转换器往往不能直接与处理器相连接,这时就需要使用FIFO在处理器与A／D转换器之间架一座桥梁,FIFO的先入先出特性可以方便缓存大量的数据块。在基于ARM的超声波测厚系统中,所用为1 MHz以上的高频超声波探头,测量数据经A／D转换后频率与A...

2023-06-13 FIFO 超声测厚系统 AD ARM接口设计文章课设毕设通信类

多端口存储器在多机系统中的应用

前言在测控、仪器仪表、语音信号处理和图像通信领域中往往需要多处理器分工完成数字信号处理（DSP）算法和与外部系统的通信、控制、数据采集和人机接口功能。在多机系统中，CPU之间的通信常采用以下几种方式：（1）串行通信。这种方式相对简单，由于受到波特率的限制，在不同档次单片机...

2023-06-13 双口 RAM FIFO 多机系统仲裁逻辑DSP 单片机文章基础课电子技术基础

串口，中断，fifo源程序代码

#include /* UART Buffer Defines */#define UART_RX_BUFFER_SIZE 16 /* 1,2,4,8,16,32,64,128 or 256 bytes */#define UART_RX_BUFFER_MASK ( UART_RX_BUFFER_SIZE - 1 )#define UART_TX_BUFFER_SIZE 16 /...

2023-06-13 串口中断 FIFO 文章软件开发程序设计

基于DSP的嵌入式 FIFO 数据传输系统设计

嵌入式设备由于具有硬件可在线配置，实现灵活等特点，使得其应用越来越广泛。尤其在基于FPGA的硬件系统中应用较多，目前在许多产品中实现了嵌入式网口、嵌入式PCI/PCI-E、嵌入式USB等各种模块。但在DSP中实现嵌入式设备还比较少，一般DSP都直接集成这些设备模块，用户选择不同型号...

2023-06-13 FIFO 数据传输 DSP 文章单片机

一种用于MEMS姿态检测的FIFO设计

MEMS传感器是采用微电子和微机械加工技术制造出来的新型传感器。目前，加速度计已普遍用于智能终端（如智能手机）中，未来几年，陀螺仪也将普遍应用到智能终端中。同时，组合传感器，如3轴加速度计+3轴磁力计，3轴加速度计+3轴陀螺仪，甚至9轴组合传感器未来都会得到广泛应用，相应地也会带...

2023-06-13 MEMS 智能终端 FIFO 同步双端口RAM 文章单片机 FPGA

51单片机的FIFO（先入先出）循环队列实现

//////////////////////////////////////////////////////////// 文件：config.h//////////////////////////////////////////////////////////#ifndef __CONFIG_H#define __CONFIG_H//这一段无需改动//This segment shou...

2023-06-13 51单片机 FIFO 循环队列文章单片机

FPGA例化的内部RAM读取延迟差异

问题在进行查找表读取实验的时候，已经验证FPGA内部RAM（单口、单时钟）读取动作在地址有效后下一个时钟读取的数据就有效，如图1所示。而在今天调试符合仿真的时候，发现仿真数据从RAM读出送给CS时需要等待2个时钟周期，如图2所示。图1：存储TLUT的RAM读取只需等待1一个时钟周期图2：存...

2023-06-13 FPGA FIFO FPGA例化内部RAM 读取延迟差异文章单片机

逻辑实现PCS模块

图1：StratixIVGX器件Transceiver数据路径框图可以看到每个transceiver通道包括发送和接收通道，其中发送通道包含了发送通道PCS以及发送通道的PMA；同样接收又进一步分为接收PCS和PMA。根据我们前面的介绍，我们知道，CMU通道中没有中间的PCS模块，需要我们自己通过代码来实现。我们...

2023-06-13 逻辑实现PCS模块 CMU FIFO 文章单片机 FPGA

FPGA异步FIFO设计中的问题与解决办法

随着数字电子系统设计规模的扩大，一些实际应用系统中往往含有多个时钟，数据不可避免地要在不同的时钟域之间传递。如何在异步时钟之间传输数据，是数据传输中一个至关重要的问题，而采用FIFO正是解决这一问题的有效方法。异步FIFO是一种在电子系统中得到广泛应用的器件，多数情况...

2023-06-13 异步 FIFO 亚稳态 FPGA 文章单片机

DSP和FPGA的双核并行通信方法设计与应用

引言线性调频连续波(Linear Frequency Modulation Continuous Wave，LFMCW)雷达在储油罐液位计量中有着广泛的应用[1]，提高雷达的测距精度从而提高计量精度，对提高经济效益有着重要的作用。随着数字信号处理技术的发展，高精度测距算法发展迅速，但是这些高精度算法需要处理的数...

2023-06-13 DSP FPGA 并行通信外部接口XINTF FIFO 双口RAM 文章单片机

零基础学FPGA（十一）FIFO的串口发送机设计及常见错误

首先来解释一下FIFO的含义，FIFO就是First Input First Output的缩写，就是先入先出的意思，按照我的理解就是，先进去的数据先出，例如一个数组的高位先进，那么读出来的时候也就高位先出。下面是百度百科的解释。FIFO一般用于不同时钟域之间的数据传输，比如FIFO的一端是AD数据采集，另...

2023-06-13 零基础 FPGA FIFO 串口发送机文章单片机

异步FIFO的FPGA实现

一、FIFO简介FIFO是英文First In First Out 的缩写，是一种先进先出的数据缓存器，它与普通存储器的区别是没有外部读写地址线，这样使用起来非常简单，但缺点就是只能顺序写入数据，顺序的读出数据，其数据地址由内部读写指针自动加1完成，不能像普通存储器那样可以由地址线决定读取或...

2023-06-13 FIFO FPGA 单片机文章

【原创】基于两种模式下的同步FIFO设计

所谓FIFO就是先进先出的意思，通俗的说，就像数据从一个管道的一端进去而从管道的另一端输出。FIFO是一个没有地址端口的存储器，它依靠内部写指针（指定写数据的位置）和读指针（指定读数据的位置）来进行数据的存储或读取。FIFO有同步FIFO和异步FIFO之分。它们的区别是同步FIFO数据的...

2023-06-13 FIFO 读取数据设计文章单片机 STM32